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TMS320VC5501ZAV300

Name: Texas Instruments TMS320VC5501ZAV300
Brand: Texas Instruments
SKU: 595-S320VC5501ZAV300
Price: 11.54 EUR
Availability: InStock

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Mouser REF:

595-S320VC5501ZAV300

Fabr. N.º:

TMS320VC5501ZAV300

Fabr.:

Texas Instruments

Descripción:

Procesadores y controladores de señal digital (DSP, DSC) Low power C55x fixed point DSP- up to 30

Hoja de datos:

TMS320VC5501ZAV300 Hoja de datos

Modelo ECAD:

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Cant.	Precio unitario	Precio total
	11,54 €	11,54 €
	8,77 €	87,70 €
	8,41 €	210,25 €
	6,67 €	667,00 €
	6,66 €	1.678,32 €
	6,61 €	3.331,44 €
	6,37 €	6.420,96 €
4.032	Cotización

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Atributo del producto	Valor del atributo	Seleccionar atributo
Fabricante:	Texas Instruments
Categoría de producto:	Procesadores y controladores de señal digital (DSP, DSC)
RoHS:
Producto:	DSPs
Núcleo:	C55x
Número de núcleos:	1 Core
Frecuencia máxima de reloj:	300 MHz
Tamaño de memoria del programa:	32 kB
Tamaño de datos RAM:	32 kB
Memoria de instrucción de caché L1:	16 kB
Voltaje operativo de suministro:	1.26 V
Serie:	TMS320VC5501
Estilo de montaje:	SMD/SMT
Temperatura operativa mínima:	- 40 C
Temperatura operativa máxima:	+ 85 C
Empaquetado:	Tray
Marca:	Texas Instruments
País de ensamblaje:	Not Available
País de difusión:	Not Available
País de origen:	PH
Sensibles a la humedad:	Yes
Tipo de producto:	DSP - Digital Signal Processors & Controllers
Cantidad del paquete de fábrica:	126
Subcategoría:	Embedded Processors & Controllers

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TARIC:: 8542319000
CNHTS:: 8542319090
CAHTS:: 8542310000
USHTS:: 8542310035
ECCN:: 3A991.a.2

TMS320VC5501 Fixed-Point Digital Signal Processor

Texas Instruments TMS320VC5501 Fixed-Point Digital Signal Processor (DSP) is based on the TMS320C55x DSP generation CPU processor core. The Texas Instruments TMS320C55x DSP architecture achieves high performance and low power through increased parallelism and total focus on reduction in power dissipation. The CPU supports an internal bus structure that is composed of one program bus, three data read buses, two data write buses, and additional buses dedicated to peripheral and DMA activity. These buses provide the ability to perform up to three data reads, and two data writes, in a single cycle. In parallel, the DMA controller can perform up to two data transfers per cycle independent of the CPU activity.

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